From 6f0ff7bc2d531873982f96a92cb5c023d719ef2c Mon Sep 17 00:00:00 2001
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Date: Fri, 14 Jun 2024 19:39:52 -0400
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 % CC BY-SA 4.0 (https://creativecommons.org/licenses/by-sa/4.0/)
 
 \par{
-    Étudiant MSc. \textbf{génie informatique} passionné par la \textbf{microélectronique}, les \textbf{réseaux}, les \textbf{FPGA}, et le \textbf{logiciel bas-niveau}. Chercheur à la \href{https://www.polymtl.ca/expertises/chaire-de-recherche-industrielle-du-crsng-en-traitement-programmable-de-paquets-haut-debit}{chaire Kaloom-Intel-Noviflow} à Polytechnique Montréal: mon projet porte sur les \textit{packet blasters} implémentés avec le langage P4 sur FPGA. J'ai effectué 24 mois de stages dont 12 mois de développement logiciel, dans un bac co-op (UW).
+    Étudiant MSc. \textbf{génie informatique} passionné par la \textbf{microélectronique}, les \textbf{réseaux}, les \textbf{FPGA}, et le \textbf{logiciel bas-niveau}. Chercheur à la \href{https://www.polymtl.ca/expertises/chaire-de-recherche-industrielle-du-crsng-en-traitement-programmable-de-paquets-haut-debit}{chaire Kaloom-Intel-Noviflow} à Polytechnique Montréal: mon projet porte sur les \textit{générateurs de trafic} implémentés sur FPGA. Je travaille également au développement FPGA d'un \textbf{DMA PCIe ULL} à \href{https://orthogone.com/ultra-low-latency-ethernet-mac/}{Orthogone Technologies}
 }
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